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高级ASIC研发工程师
40k-70k
北京
经验5-10年
硕士及以上
IC设计工程师
岗位所属职位类型
全职
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Verilog
信息安全
ARM
融数联智
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职位诱惑:
五险一金
职位描述:
职位职责:
1. 负责ASIC芯片的RTL设计与集成
2. 负责ASIC芯片的逻辑设计优化和设计流程优化
3. 负责ASIC芯片的验证
职位要求:
1. 微电子、计算机等相关专业本科及以上学历,3年及以上IC设计经验
2. 对芯片前端设计有深入理解,有坚实的RTL设计基础,精通Verilog等硬件设计语言
3. 熟悉ASIC芯片的前端设计,有过28nm,22nm,14nm或更先进工艺流片或量产经验者优先
4. 深入理解芯片架构和微架构设计
5. 熟悉DDR/PCIE/HBM等协议,有相关的IP集成经验
6. 熟悉ASIC实现流程,有综合/STA等经验
7. 有CPU高性能计算的设计经验者优先
8. 有同态加密算法设计经验者优先
9. 自律,有良好的英语阅读能力,有主动学习,深入分析和解决问题的能力
工作地址
北京
-
西城区
-
小西天
- 新街口外大街28号普天德胜
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职位发布者:
袁媛
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技术总监
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